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• 005 20050614094700.0

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• 099 __ |a CAL 012004128415

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• 101 1_ |a chi |c eng

• 102 __ |a CN |b 110000

• 105 __ |a ak a 000yy

• 106 __ |a r

• 200 1_ |a Verilog HDL数字设计与综合 |A verilog hdl shu zi she ji yu zong he |d = Verilog HDL: a guide to digital design and synthesis |f (美) Samir Palnitkar著 |g 夏宇闻, 胡燕祥, 刁岚松等译 |z eng

• 210 __ |a 北京 |c 电子工业出版社 |d 2004

• 215 __ |a 306页 |c 图 |d 26cm

• 225 2_ |a 国外电子与通信教材系列 |A guo wai dian zi yu tong xin jiao cai xi lie

• 305 __ |a 据原书2003年英文版第2版译出

• 306 __ |a 由电子工业出版社和Pearson Education培生教育出版亚洲有限公司合作出版

• 314 __ |a 责任者汉译姓取自在版编目: 帕尔尼卡

• 320 __ |a 有书目

• 410 _0 |1 2001 |a 国外电子与通信教材系列

• 510 1_ |a Verilog HDL |e a guide to digital design and synthesis |z eng

• 606 0_ |a VHDL语言 |A vhdl yu yan |x 程序设计

• 690 __ |a TP312VH |v 4

• 690 __ |a TP312 |v 4

• 701 _1 |a 帕尔尼卡, |A pa er ni ka |b S. |g (Palnitkar, Samir) |4 著

• 702 _0 |a 夏宇闻 |A xia yu wen |4 译

• 702 _0 |a 胡燕祥 |A Hu Yan Xiang |4 译

• 702 _0 |a 刁岚松 |A Diao Lan Song |4 译

• 801 _0 |a CN |b BUPT |c 20041122

• 801 _2 |a CN |b JHUL |c 20050614

• 905 __ |a JHUL |d TP312VH/11