机读格式显示(MARC)

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• 200 1_ |a 基于Quartus II的FPGA/CPLD数字系统设计实例 |A ji yu Quartus II de FPGA/CPLD shu zi xi tong she ji shi li |f 周润景, 图雅, 张丽敏编著

• 210 __ |a 北京 |c 电子工业出版社 |d 2007

• 215 __ |a 451页 |c 图 |d 26cm

• 225 2_ |a EDA应用技术 |A EDA ying yong ji shu

• 320 __ |a 有书目 (第451页)

• 410 _0 |1 2001 |a EDA应用技术

• 606 0_ |a 可编程序逻辑器件 |A ke bian cheng xu luo ji qi jian |x 系统设计

• 690 __ |a TP332.1 |v 4

• 701 _0 |a 周润景 |A zhou run jing |4 编著

• 701 _0 |a 图雅 |A tu ya |4 编著

• 701 _0 |a 张丽敏 |A zhang li min |4 编著

• 801 _0 |a CN |b BUPT |c 20070918

• 905 __ |a JHUL |d TP332.1/54